Texas Instruments TMS320DM36X Benutzerhandbuch

www.ti.com

The comparison A/D Upper data (CMPUDAT) register is shown in

and described in

31

10

9

0

Reserved

CMPUDAT

R-0

R/W-0

LEGEND: R/W = Read/Write; R = Read only; -n = value after reset

31-10

Reserved

0

Any writes to these bit(s) must always have a value of 0.

9-0

CMPUDAT

Comparativer data (upper) value of CMPUDAT should be the same as or larger than that of
CMPLDAT.

The SETUP divide value for start A/D conversion (SETDIV) register is shown in

and described in

.

A/D conversion time is obtained by Analog switch setup time + ADC setup time + A/D conversion time.
Analog switch setup time = Peripheral CLK period * (SET_DIV[5:0] + 3)*2
ADC setup time = Peripheral CLK period * (SET_DIV[15:0] + 1)*2
A/D conversion time = Peripheral CLK period* (SET_DIV[5:0] + 1)*24.

Note: A/D conversion time can't be less than 6us.

31

16

Reserved

R-0

15

0

SETDIV

R/W-0xFFFF

LEGEND: R/W = Read/Write; R = Read only; -n = value after reset

31-16

Reserved

0

Any writes to these bit(s) must always have a value of 0.

15-0

SETDIV

SETDIV bits set the Analog switch setup time, ADC setup (Idle) time and A/D conversion time.
Analog switch setup time = Peripheral CLK period * (SET_DIV[5:0] + 3)*2
ADC setup time = Peripheral CLK period * (SET_DIV[15:0] + 1)*2
A/D conversion time = Peripheral CLK period* (SET_DIV[5:0] + 1)*24.

The analog Input channel select (CHSEL) register is shown in

and described in

. CHSEL

setting for the selection of different channel is shown in

. In order to select two or more channels,

ORing of these setting is needed.

14

SPRUFI7 – March 2009