Texas Instruments Digital Signal Processor TMS320C6201 User Manual
SPRZ153
TMS320C6201 Silicon Errata
2
Contents
1
Introduction
4
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.1
Quality and Reliability Conditions
4
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TMX Definition
4
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TMP Definition
4
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TMS Definition
4
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1.2
Revision Identification
5
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2
Changes to the TMS320C6201 Data Sheet (literature number SPRS051)
6
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3
Silicon Revision 3.1 Known Design Exceptions to Functional Specifications
8
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.1
Issues When Pausing at a Block Boundary
8
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.2
DMA: Transfer Incomplete When Pausing a Synchronized Transfer in Mid-frame
8
. . . . . . . . . . . . . .
Advisory 3.1.3
DMA Multiframe Split-mode Transfers Source Address Indexing Not Functional
9
. . . . . . . . . . . . . . .
Advisory 3.1.4
DMA: Stopped Transfer Reprogrammed Does Not Wait for Sync
9
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.5
DMA Freezes if Postincrement/Decrement Across Port Boundary
9
. . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.6
DMA Paused During Emulation Halt
10
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.7
DMA: RSYNC = 10000b (DSPINT) Does Not Wait for Sync
10
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.8
EMIF: Invalid SDRAM Access to Last 1K Byte of CE3
10
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.1.9
Cache During Emulation With Extremely Slow External Memory
11
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
4
Silicon Revision 3.0 Known Design Exceptions to Functional Specifications
12
. . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.0.8
EMIF: Inverted SDCLK and SSCLK at Speeds Above 175 MHz
12
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 3.0.9
CPU: L2-unit Long Instructions Corrupted During Interrupt
14
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5
Silicon Revision 2.1 Known Design Exceptions to Functional Specifications
15
. . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.1
EMIF: CE Space Crossing on Continuous Request Not Allowed
15
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.2
EMIF: SDRAM Invalid Access
15
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Advisory 2.1.4
DMA: RSYNC Cleared Late for Frame-synchronized Transfer
16
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.5
McBSP: DXR to XSR Copy Not Generated
16
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.6
DMA Split-mode End-of-frame Indexing
18
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Advisory 2.1.7
DMA Channel 0 Multiframe Split-Mode Incompletion
19
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.8
Timer Clock Output Not Driven for External Clock
19
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.9
Power-Down Pin PD Not Set High for Power-Down 2 Mode
19
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.10 EMIF: RBTR8 Bit Not Functional
19
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.11 McBSP: Incorrect mLaw Companding Value
20
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Advisory 2.1.12 False Cache Hit – Extremely Rare
20
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Advisory 2.1.13 EMIF: HOLD Feature Improvement on Revision 3
20
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Advisory 2.1.14 EMIF: HOLD Request Causes Problems With SDRAM Refresh
21
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.15 DMA Priority Ignored by PBUS
21
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Advisory 2.1.16 DMA Split-mode Receive Transfer Incomplete After Pause
22
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Advisory 2.1.17 DMA Multiframe Transfer Data Lost During Stop
22
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Advisory 2.1.18 Bootload: HPI Feature Improvement on Revision 3
22
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