Texas Instruments TPS59650 Evaluation Module TPS59650EVM-753 TPS59650EVM-753 Fiche De Données

Codes de produits
TPS59650EVM-753
Page de 73
3
USB Cable
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4
TPS59650EVM-753 Recommended Test Set Up
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5
TPS59650EVM-753 CPU GUI set up Window
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6
TPS59650EVM-753 GPU GUI set up Window
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7
CPU3 Efficiency
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8
CPU3 Load regulation
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9
CPU3 Enable Turn on
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10
CPU3 Enable Turn off
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11
CPU3 Switching Node(Ripple)
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12
CPU3 Dynamic VID: SetVID-Slow/Slow
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13
CPU3 Dynamic VID:SetVID-Fast/Fast
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14
CPU3 Dynamic VID:SetVID-Decay/Fast
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15
CPU3 Output Load Insertion with OSR/USR middle level
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16
CPU3 Output Load Release with OSR/USR middle level
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17
CPU3 Bode Plot at 12Vin, 1.05V/60A
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18
CPU3 MOSFET
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19
CPU3 IC
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20
CPU2 Efficiency
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21
CPU2 Load regulation
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22
CPU2 Enable Turn on
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23
CPU2 Enable Turn off
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24
CPU2 Switching Node(Ripple)
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25
CPU2 Dynamic VID: SetVID-Slow/Slow
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26
CPU2 Dynamic VID:SetVID-Fast/Fast
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27
CPU2 Dynamic VID:SetVID-Decay/Fast
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28
CPU2 Output Load Insertion with OSR/USR middle level
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29
CPU2 Output Load Release with OSR/USR middle level
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30
CPU2 Bode Plot at 12Vin, 1.05V/55A
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31
CPU2 MOSFET
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32
CPU2 IC
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33
CPU1 Efficiency
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34
CPU1 Load regulation
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35
CPU1 Enable Turn on
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36
CPU1 Enable Turn off
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37
CPU1 Switching Node
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38
CPU1 Switching node and Ripple
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39
CPU1 Dynamic VID:SetVID-Slow/Slow
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40
CPU1 Dynamic VID:SetVID-Fast/Fast
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41
CPU1 Dynamic VID:SetVID-Decay/Fast
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42
CPU1 Output Load Insertion with OSR/USR middle level
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43
CPU1 Output Load Release with OSR/USR middle level
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44
CPU1 Bode Plot at 12Vin, 1.05V/33A
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45
CPU1 MOSFET
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46
CPU1 IC
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47
GPU2 Efficiency
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48
GPU2 Load regulation
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49
GPU2 Enable Turn on
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50
GPU2 Enable Turn off
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51
GPU2 Switching Node and Ripple
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2
Using the TPS59650EVM-753 Intel™ IMVP-7 3-Phase CPU/2-Phase GPU
SLUU896 – March 2012
SVID Power System
Copyright © 2012, Texas Instruments Incorporated