Xilinx ML361 Virtex-II Pro ユーザーズマニュアル

ML361 Virtex-II Pro Memory Board

www.xilinx.com

UG060 (v1.2) November 8, 2007

Schedule of Figures

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Schedule of Tables

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Preface: About This Guide

Guide Contents

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Additional Resources

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Conventions

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Typographical . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Online Document . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10

Chapter 1: Introduction

Overview

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Features

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Chapter 2: Architecture

ML361 Board Block Diagram

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Block Descriptions

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FPGA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Memories . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

DDR SDRAM DIMM (Banks 6 and 7)

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DDR SDRAM Components (Banks 2 and 3)

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DDR SDRAM Component (Bank 1)

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RS232 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

200 MHz LVDS Clock

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166 MHz LVDS Test Clock

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SMA Clock

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User I/Os . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Mictor Connectors

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GPIO

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DIP Switch

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Seven-Segment Displays

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LEDs

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Push Buttons

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Grounded I/Os

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Power . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Power Distribution

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Input Voltage

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3.3 V Generation

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2.6 V Generation

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1.5 V Generation

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1.3 V Generation

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Linear Regulators for the MGTs

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