Epson S1D13504 ユーザーズマニュアル

ページ / 504
Epson Research and Development
Page 3
Vancouver Design Center
Programming Notes and Examples
S1D13504
Issue Date: 01/02/01 
X19A-G-002-07
Table Of Contents
Introduction  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  .  7
Programming the S1D13504 Registers   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  8
2.1 
Registers Requiring Special Consideration   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   . 8
2.1.1 
REG[01] bit 0 - Memory Type    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .8
2.1.2 
REG[22] bits 7-2 - Performance Enhancement Register 0   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 8
2.1.3 
REG[02] bit 1 - Dual/Single Panel Type   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 8
2.1.4 
REG[1B] bit 0 - Half Frame Buffer Disable    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   . 9
2.1.5 
REG[23] Display FIFO:  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 9
2.2 
Register Initialization    .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   . 9
2.2.1 
Initialization Sequence    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .9
2.2.2 
Initialization Example  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  10
2.2.3 
Re-Programming Registers   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  11
2.3 
Disabling the Half Frame Buffer Sequence:     .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .  11
Display Buffer .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .    12
3.1 
Display Buffer Location    .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .  12
3.2 
Display Buffer Organization     .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .  12
3.2.1 
Memory Organization for One Bit-per-pixel (2 Colors/Gray Shades)    .  .  .  .  .  .  .  .  .  .  .  .  .  12
3.2.2 
Memory Organization for Two Bit-per-pixel (4 Colors/Gray Shades)   .  .  .  .  .  .  .  .  .  .  .  .  . 12
3.2.3 
Memory Organization for Four Bit-per-pixel (16 Colors/Gray Shades)    .  .  .  .  .  .  .  .  .  .  .  . 13
3.2.4 
Memory Organization for Eight Bit-per-pixel (256 Colors)    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 13
3.2.5 
Memory Organization for 15 Bit-per-pixel (32768 Colors)  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 14
3.2.6 
Memory Organization for 16 Bit-per-pixel (65536 Colors)  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 14
3.3 
Look-Up Table (LUT)  .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .  15
3.3.1 
Look-Up Table Registers   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  15
3.3.2 
Look-Up Table Organization   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  . 17
Advanced Techniques   .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   23
4.1 
Virtual Display  .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .    .   .  23
4.1.1 
Registers  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 24
4.1.2 
Examples    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 24
4.2 
Panning and Scrolling   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   25
4.2.1 
Registers  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 26
4.2.2 
Examples    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 27
4.3 
Split Screen   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .    .   .   .  28
4.3.1 
Registers  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 28
4.3.2 
Examples    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   .  . 29
LCD Power Sequencing and Power Save Modes    .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .  .   30
5.1 
Introduction to LCD Power Sequencing   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   30
5.2 
Introduction to Power Save Modes   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   30
5.3 
Registers    .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .  30
5.4 
Suspend Sequencing .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   .   31