Manualsbrain.com
  1. 매뉴얼
  2. 브랜드
  3. Texas Instruments
  4. AM18x eXperimenter's Kit TMDSEXP1808L
  5. 데이터 시트

Texas Instruments AM18x eXperimenter's Kit TMDSEXP1808L TMDSEXP1808L 데이터 시트

제품 코드
TMDSEXP1808L
다운로드
페이지 중 264
SPRS653E – FEBRUARY 2010 – REVISED MARCH 2014
Table 6-50. Switching Characteristics for McASP0 (1.3V, 1.2V, 1.1V)
(1)
1.3V, 1.2V
1.1V
NO.
PARAMETER
UNIT
MIN
MAX
MIN
MAX
9
t
c(AHCLKRX)
Cycle time, AHCLKR/X
25
28
ns
10
t
w(AHCLKRX)
Pulse duration, AHCLKR/X high or low
AH – 2.5
(2)
AH – 2.5
(2)
ns
11
t
c(ACLKRX)
Cycle time, ACLKR/X
ACLKR/X int
25
(3) (4)
28
(3) (4)
ns
12
t
w(ACLKRX)
Pulse duration, ACLKR/X high or low
ACLKR/X int
A – 2.5
(5)
A – 2.5
(5)
ns
ACLKR/X int
-1
6
-1
8
ns
Delay time, ACLKR/X transmit edge
13
t
d(ACLKRX-AFSRX)
ACLKR/X ext input
2
13.5
2
14.5
ns
to AFSX/R output valid
(6)
ACLKR/X ext output
2
13.5
2
14.5
ns
ACLKR/X int
-1
6
-1
8
ns
Delay time, ACLKX transmit edge to
14
t
d(ACLKX-AXRV)
ACLKR/X ext input
2
13.5
2
15
ns
AXR output valid
ACLKR/X ext output
2
13.5
2
15
ns
Disable time, ACLKR/X transmit
ACLKR/X int
0
6
0
8
ns
15
t
dis(ACLKX-AXRHZ)
edge to AXR high impedance
ACLKR/X ext
2
13.5
2
15
ns
following last data bit
(1)
McASP0 ACLKX0 internal – ACLKXCTL.CLKXM = 1, PDIR.ACLKX = 1
ACLKX0 external input – McASP0 ACLKXCTL.CLKXM = 0, PDIR.ACLKX = 0
ACLKX0 external output – McASP0ACLKXCTL.CLKXM = 0, PDIR.ACLKX = 1
ACLKR0 internal – McASP0 ACLKR0CTL.CLKRM = 1, PDIR.ACLKR =1
ACLKR0 external input – McASP0 ACLKRCTL.CLKRM = 0, PDIR.ACLKR = 0
ACLKR0 external output – McASP0 ACLKRCTL.CLKRM = 0, PDIR.ACLKR = 1
(2)
AH = (AHCLKR/X period)/2 in ns. For example, when AHCLKR/X period is 25 ns, use AH = 12.5 ns.
(3)
P = SYSCLK2 period
(4)
This timing is limited by the timing shown or 2P, whichever is greater.
(5)
A = (ACLKR/X period)/2 in ns. For example, when AHCLKR/X period is 25 ns, use AH = 12.5 ns.
(6)
McASP0 ACLKXCTL.ASYNC=1: Receiver is clocked by its own ACLKR0
Table 6-51. Switching Characteristics for McASP0 (1.0V)
(1)
1.0V
NO.
PARAMETER
UNIT
MIN
MAX
9
t
c(AHCLKRX)
Cycle time, AHCLKR/X
35
ns
10
t
w(AHCLKRX)
Pulse duration, AHCLKR/X high or low
AH – 2.5
(2)
ns
11
t
c(ACLKRX)
Cycle time, ACLKR/X
ACLKR/X int
35
(3) (4)
ns
12
t
w(ACLKRX)
Pulse duration, ACLKR/X high or low
ACLKR/X int
A – 2.5
(5)
ns
ACLKR/X int
-0.5
10
ns
Delay time, ACLKR/X transmit edge to AFSX/R output
13
t
d(ACLKRX-AFSRX)
ACLKR/X ext input
2
19
ns
valid
(6)
ACLKR/X ext output
2
19
ns
ACLKR/X int
-0.5
10
ns
14
t
d(ACLKX-AXRV)
Delay time, ACLKX transmit edge to AXR output valid
ACLKR/X ext input
2
19
ns
ACLKR/X ext output
2
19
ns
ACLKR/X int
0
10
ns
Disable time, ACLKR/X transmit edge to AXR high
15
t
dis(ACLKX-AXRHZ)
impedance following last data bit
ACLKR/X ext
2
19
ns
(1)
McASP0 ACLKX0 internal – ACLKXCTL.CLKXM = 1, PDIR.ACLKX = 1
ACLKX0 external input – McASP0 ACLKXCTL.CLKXM = 0, PDIR.ACLKX = 0
ACLKX0 external output – McASP0ACLKXCTL.CLKXM = 0, PDIR.ACLKX = 1
ACLKR0 internal – McASP0 ACLKR0CTL.CLKRM = 1, PDIR.ACLKR =1
ACLKR0 external input – McASP0 ACLKRCTL.CLKRM = 0, PDIR.ACLKR = 0
ACLKR0 external output – McASP0 ACLKRCTL.CLKRM = 0, PDIR.ACLKR = 1
(2)
AH = (AHCLKR/X period)/2 in ns. For example, when AHCLKR/X period is 25 ns, use AH = 12.5 ns.
(3)
P = SYSCLK2 period
(4)
This timing is limited by the timing shown or 2P, whichever is greater.
(5)
A = (ACLKR/X period)/2 in ns. For example, when AHCLKR/X period is 25 ns, use AH = 12.5 ns.
(6)
McASP0 ACLKXCTL.ASYNC=1: Receiver is clocked by its own ACLKR0
Copyright © 2010–2014, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
139
Product Folder Links: