Texas Instruments Development Kit for TM4C129x,Tiva™ ARM® Cortex™ -M4 Microcontroller DK-TM4C129X DK-TM4C129X Datenbogen

This register is programmed to set the timer period for the SCL clock and assign the SCL clock to
either standard or high-speed mode.

I2C Master Timer Period (I2CMTPR)

I2C 0 base: 0x4002.0000
I2C 1 base: 0x4002.1000
I2C 2 base: 0x4002.2000
I2C 3 base: 0x4002.3000
I2C 4 base: 0x400C.0000
I2C 5 base: 0x400C.1000
I2C 6 base: 0x400C.2000
I2C 7 base: 0x400C.3000
I2C 8 base: 0x400B.8000
I2C 9 base: 0x400B.9000
Offset 0x00C
Type RW, reset 0x0000.0001

16

17

18

19

20

21

22

23

24

25

26

27

28

29

30

31

PULSEL

reserved

RW

RW

RW

RO

RO

RO

RO

RO

RO

RO

RO

RO

RO

RO

RO

RO

Type

0

0

0

0

0

0

0

0

0

0

0

0

0

0

0

0

Reset

0

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

TPR

HS

reserved

RW

RW

RW

RW

RW

RW

RW

WO

RO

RO

RO

RO

RO

RO

RO

RO

Type

1

0

0

0

0

0

0

0

0

0

0

0

0

0

0

0

Reset

Description

Reset

Type

Name

Bit/Field

Software should not rely on the value of a reserved bit. To provide
compatibility with future products, the value of a reserved bit should be
preserved across a read-modify-write operation.

0x0000.00

RO

reserved

31:19

Glitch Suppression Pulse Width

This field controls the pulse width select for glitch suppression on the
SCL and SDA lines. The following values are the glitch suppression
values in terms of system clocks.

Description

Value

Bypass

0x0

1 clock

0x1

2 clocks

0x2

3 clocks

0x3

4 clocks

0x4

8 clocks

0x5

16 clocks

0x6

31 clocks

0x7

0x0

RW

PULSEL

18:16

Software should not rely on the value of a reserved bit. To provide
compatibility with future products, the value of a reserved bit should be
preserved across a read-modify-write operation.

0x0000.00

RO

reserved

15:8