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3.12 Machine à sous 
 
Des machines à sous sont installées dans de nombreux bars et bien sûr à Las Vegas. Avec ces machines, vous devez appuyer sur une 
touche et attendre jusqu’à ce que les symboles ou les rouleaux s’arrêtent. Si une combinaison définie s’affiche, vous avez gagné. Les 
machines à sous sont également équipées d’un mode qui permet de multiplier le gain. Un bouton et un indicateur clignotent alors en 
alternance pour la multiplication du gain. En cas de pression sur le bouton au bon moment, vous activez le niveau de multiplication 
supérieur. En cas de pression sur le bouton au bon moment, vous perdez tous vos gains. Le circuit ci-après présente exactement ce 
mode. La DEL V1 clignote lentement et le bouton-poussoir doit toujours être enfoncé lorsque la DEL s’allume. Le cas contraire, la position 
du compteur reste figée. En cas de pression sur le bouton lorsque la diode électroluminescente n’est pas allumée, le compteur est remis 
à zéro et tous les gains sont perdus. 
 
R1 
R1 
R2 
R2 
R3 
R3 
R4 
R4 
R5 
R5 
R6 
R6 
R7 
R7 
R8 
R8 
R9 
R9 
V1 
V1 
V2 
V2 
V3 
V3 
C1 
C1 
 
Fig. 33 : Schéma du tableau de connexions pour la machine à sous 
 
 
Description du circuit 
La cadence est générée par la porte IC1A via la résistance R1 et le condensateur C1. Lorsqu’un niveau High est défini pour la cadence, le 
courant circule à travers la diode électroluminescente V1 par le biais de la résistance R2 et allume cette diode. Le transistor T2 est 
simultanément activé via la résistance R4 et définit un niveau Low sur la broche de réinitialisation (MR). L’inverseur IC1B définit un 
niveau Low sur la broche 4 et le transistor T1 a une haute impédance. L’entrée de la cadence (unité centrale) est déviée vers la masse 
par le biais des résistances R5 et R7. Cela change dès que le bouton-poussoir est enfoncé. L’entrée de la cadence est alors directement 
raccordée à la tension d’alimentation via la résistance R5 et un flanc croissant, qui augmente la position du compteur, est généré. 
 
 
C1 
C1 
C2 
C2 
10μ 
10μ 
100μ 
100μ 
V+ 
V+ 
IC1A 
IC1A 
R1 
R1 
100k 
100 k 
IC1D 
IC1D 
S1 
S1 
R2 
R2 
3,3k 
3,3 k 
IC1C 
IC1C 
IC2 
IC2 
IC1B 
IC1B 
VDD 
VDD 
CPU 
Unité centrale 
D0 
D0 
D1 
D1 
D2 
D2 
D3 
D3 
PL 
PL 
CPD 
CPD