Texas Instruments Development Kit for TM4C129x,Tiva™ ARM® Cortex™ -M4 Microcontroller DK-TM4C129X DK-TM4C129X Datenbogen

This register can only be accessed from privileged mode.

The MMADDR register contains the address of the location that generated a memory management
fault. When an unaligned access faults, the address in the MMADDR register is the actual address
that faulted. Because a single read or write instruction can be split into multiple aligned accesses,
the fault address can be any address in the range of the requested access size. Bits in the Memory
Management Fault Status (MFAULTSTAT) register indicate the cause of the fault and whether
the value in the MMADDR register is valid (see page 194).

Memory Management Fault Address (MMADDR)

Base 0xE000.E000
Offset 0xD34
Type RW, reset -

16

17

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28

29

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31

ADDR

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

Type

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

Reset

0

1

2

3

4

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8

9

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12

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15

ADDR

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

Type

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

Reset

Description

Reset

Type

Name

Bit/Field

Fault Address

When the

MMARV

bit of MFAULTSTAT is set, this field holds the address

of the location that generated the memory management fault.

-

RW

ADDR

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