Texas Instruments Development Kit for TM4C129x,Tiva™ ARM® Cortex™ -M4 Microcontroller DK-TM4C129X DK-TM4C129X Datenbogen

This register can only be accessed from privileged mode.

The FAULTADDR register contains the address of the location that generated a bus fault. When
an unaligned access faults, the address in the FAULTADDR register is the one requested by the
instruction, even if it is not the address of the fault. Bits in the Bus Fault Status (BFAULTSTAT)
register indicate the cause of the fault and whether the value in the FAULTADDR register is valid
(see page 194).

Bus Fault Address (FAULTADDR)

Base 0xE000.E000
Offset 0xD38
Type RW, reset -

16

17

18

19

20

21

22

23

24

25

26

27

28

29

30

31

ADDR

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

Type

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

Reset

0

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

ADDR

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

RW

Type

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

-

Reset

Description

Reset

Type

Name

Bit/Field

Fault Address

When the

FAULTADDRV

bit of BFAULTSTAT is set, this field holds the

address of the location that generated the bus fault.

-

RW

ADDR

31:0

This section lists and describes the Memory Protection Unit (MPU) registers, in numerical order by
address offset.

The MPU registers can only be accessed from privileged mode.