Texas Instruments DM6467 Digital Video Evaluation Module TMDXEVM6467T TMDXEVM6467T Datenbogen

SPRS605C – JULY 2009 – REVISED JUNE 2012

The DM6467T device has a large number of interrupts to service the needs of its many peripherals and
subsystems. Both the ARM and C64x+ are capable of servicing these interrupts. All of the device
interrupts are routed to the ARM interrupt controller with only a limited set routed to the C64x+ interrupt
controller. The interrupts can be selectively enabled or disabled in either of the controllers. In typical
applications, the ARM handles most of the peripheral interrupts and grants control to the C64x+ for
interrupts that are relevant to DSP algorithms. Also, the ARM and DSP can communicate with each other
through interrupts.

The ARM926 CPU core supports 2 direct interrupts: FIQ and IRQ. The DM6467T ARM interrupt controller
prioritizes up to 64 interrupt requests from various peripherals and subsystems, which are listed in

, and interrupts the ARM CPU. Each interrupt is programmable for up to 8 levels of priority.

There are 6 levels for IRQ and 2 levels for FIQ. Interrupts at the same priority level are serviced in order
by the ARM Interrupt Number, with the lowest number having the highest priority.

shows the

ARM interrupt controller registers and memory locations. For more details on ARM interrupt control, see
the TMS320DM646x DMSoC ARM Subsystem Reference Guide (literature number

).

Copyright © 2009–2012, Texas Instruments Incorporated

193

Product Folder Link(s):